Resolviendo El Programa De Uso; La Cpu Utiliza El Área De La Memoria Imagen De Salida Para Almacenar El Estado De Acciones; Resolviendo Los Algoritmos De Lazos De Control Pid; Barrido Normal En Modo Run - AutomationDirect PLC DL06 Serie Manual Del Usuario

Capítulo 3: Especificaciones y operación

Resolviendo el programa de uso

La CPU evalúa cada instrucción en el programa de
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uso durante este segmento del ciclo de barrido. Las
instrucciones definen la relación entre las
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condiciones de entradas y la respuesta deseada de
salidas.
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La CPU utiliza el área de la memoria imagen de
salida para almacenar el estado de acciones
deseadas para las salidas.
3
Las direcciones de memoria imagen de salida se
designan con una Y seguida por una dirección de
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memoria.
Las salidas reales son actualizadas durante el
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segmento de escritura de las salidas del ciclo de
barrido.
7
Hay
disponibles
inmediatamente en vez de esperar hasta que venga
8
el segmento de escritura.
Se muestra una lista completa de las instrucciones
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inmediatas en el capítulo 5.
Los relevadores internos de control (C), las etapas
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(S) y la memoria variable (V) también se actualizan
en este segmento.
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Usted puede recordar que se puede forzar varios tipos de elementos en el sistema (esto fue
discutido anteriormente en este capítulo).
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Si cualquiera entrada o salida o datos se han forzado en la memoria, la memoria imagen
también contiene esta información.
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Resolviendo los algoritmos de lazos de control PID

EL PLC DL06 puede procesar hasta 8 lazos de control PID. Los cálculos de lazos funcionan
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como tarea separada de la ejecución de programa ladder, inmediatamente después de ella.
Solamente se calculan los lazos que se han configurado y solamente según un planificador
incorporado de lazos.
A
El tiempo de muestreo (intervalo de cálculo) de cada lazo es programable. Vea por favor el
capítulo 8, operación de lazos de control PID, para más información de los efectos de cálculos
B
de lazos de control PID sobre el tiempo total del barrido de la CPU.
C
D
3–16
Manual del PLC DL06, 2a. edición en español, 3/07
instrucciones de salidas
que actualizarán
G LG 0V Y0 Y2 C1
AC(L) AC(N) 24V C0 Y1 Y3 Y4
OUTPUT: 6-240V 50 - 60Hz 2.0A, 6 - 27V 2.0A
Y
0 1 2 3 4 5 6 7 10 11 12
X
INPUT: 12 - 24V 3 - 15mA
C0 X1 X3 X4 X6 C2 X11
X0 X2 C1 X5 X7 X10

Barrido normal en modo RUN

Lee entradas desde módulos especiales
Comunicación con los periféricos
inmediatas
Actualiza relevadores especiales
las salidas
Resuelve el programa de uso
Escribe salidas a módulos especiales
Y5 Y7 Y10 Y12 C3 Y15 Y17
Y6 C2 Y11 Y13 Y14 Y16 N.C.
PWR: 100-240V 50-60Hz 40VA
D0-06DR
13 14 15 16 17 20 21 22 23
X13 X14 X16 C4 X21 X23 N.C.
X12 C3 X15 X17 X20 X22 N.C.
PORT1 PORT2 RUN STOP
Diagnósticos
PWR
RUN
CPU
TX1
RX1
TX2
RX2
TERM